대학생활 · 모든 회사 / 회로설계

Q. 전자전기공학과 학부 연구생 면담 문의

오읍

PLL, ADC를 설계하는 랩에 학부 연구생 컨택을 하고 면담 일정이 잡혔습니다. 교수님에게 이전에 대학원에서 필요한 과목을 물었고 전자회로, asic 설계 등을 대답하셨습니다. 학부연구생 면담에서 무엇을 준비하는 게 좋을까요?


2026.08.03

답변 4

  • 다할수있습니다큐비앤맘
    코이사 ∙ 채택률 58%

    채택된 답변

    조금이라도 도움이 되셨다면 채택 부탁드립니다 ~~~~ 학부연구생 면담에서는 지식을 완벽하게 갖춘 것보다 배우려는 태도와 관심을 더 중요하게 봅니다. 왜 PLL과 ADC에 관심이 생겼는지, 졸업 후 어떤 진로를 생각하는지 정도는 미리 정리해 가시면 좋습니다. 전자회로, 반도체, ASIC 관련 과목을 어느 정도 공부했는지, Cadence나 Verilog 경험이 있는지도 질문받을 수 있으니 솔직하게 답변하시면 됩니다. 또한 연구실에서 최근 진행한 논문이나 프로젝트를 간단히 찾아보고 궁금한 점을 2~3개 정도 준비해 가면 좋은 인상을 줄 수 있습니다. 무엇보다 잘하려고 하기보다 꾸준히 배우고 연구에 참여하겠다는 의지를 보여주는 것이 학부연구생 면담에서는 가장 중요한 평가 요소입니다.

    2026.08.03


  • l
    lspds한국자동차연구원
    코사원 ∙ 채택률 100%
    직무
    일치

    채택된 답변

    학부 연구생 면담에서는 기초 지식과 연구 의지, 그리고 발전 가능성을 주로 봅니다. 따라서 MOSFET과 논리회로 등 전반적인 전자공학 기초를 한 번 복습하고 가시는 거 추천드립니다. 무엇보다 다른 랩실이 아닌 왜 이곳에 지원했는지, 최종 목표가 무엇인지 등의 질문에 대해 지원자의 차별화면 답변을 준비하면 좋을 것 같아요

    2026.08.03


  • P
    PRO액티브현대트랜시스
    코전무 ∙ 채택률 100%

    PLL과 ADC 설계 랩에 학부연구생으로 들어가려는 상황이라면 면담에서는 단순히 관련 지식을 많이 아는 것보다 연구 분야에 대한 관심과 기본적인 회로 설계 역량을 갖추고 있다는 점을 보여주는 것이 중요합니다. 교수님은 학부연구생에게 완성된 연구 능력을 기대하기보다 앞으로 배우면서 성장할 가능성과 연구에 대한 태도를 보는 경우가 많습니다. 우선 교수님이 말씀하신 전자회로와 ASIC 설계 과목의 핵심 내용을 복습하는 것을 추천합니다. 전자회로에서는 MOSFET 동작 원리, 증폭기 구조, 차동 증폭기, 전류 미러, 주파수 응답, 피드백 개념 정도는 설명할 수 있도록 준비하는 것이 좋습니다. PLL과 ADC는 모두 아날로그 회로 기반의 이해가 필요하기 때문에 MOS 소자의 동작과 증폭기 설계 개념이 기본이 됩니다. PLL 관련해서는 전체 구조를 이해하고 가면 좋습니다. 기본적으로 PLL은 기준 클럭과 출력 클럭의 위상 차이를 비교하고 이를 조절해 원하는 주파수를 생성하는 회로입니다. 일반적인 구조는 위상검출기 또는 위상주파수검출기, 차지펌프, 루프 필터, 전압제어발진기, 분주기로 구성됩니다. 각 블록이 어떤 역할을 하는지와 PLL이 왜 필요한지 정도는 설명할 수 있으면 좋습니다. 예를 들어 통신 시스템에서 주파수 동기화나 클럭 생성에 활용된다는 정도를 이해하면 충분합니다. ADC는 아날로그 신호를 디지털 데이터로 변환하는 회로라는 기본 개념과 주요 구조를 알아두면 좋습니다. SAR ADC, Pipeline ADC, Flash ADC, Sigma Delta ADC 등의 차이를 간단히 정리하고 해상도와 변환 속도, 전력 소모가 어떤 관계가 있는지 정도를 공부하면 도움이 됩니다. 특히 ADC 성능 지표인 ENOB, SNR, Sampling rate, DNL, INL 같은 용어는 면담에서 관심을 보여주기 좋은 부분입니다. ASIC 설계와 관련해서는 설계 흐름을 이해하면 좋습니다. RTL 설계, 논리 합성, 배치 배선, 검증 과정 등 디지털 IC 설계 과정의 큰 흐름을 알고 있으면 교수님이 설명하는 내용을 이해하기 쉽습니다. Verilog나 SystemVerilog 경험이 있다면 간단한 설계 경험을 정리해 가는 것도 좋습니다. 면담에서는 다음과 같은 질문을 받을 가능성이 있습니다. 왜 이 연구실에 지원했는지, PLL과 ADC에 관심을 가진 이유가 무엇인지, 대학원 진학 의향이 있는지, 앞으로 배우고 싶은 것이 무엇인지 등이 대표적입니다. 따라서 단순히 반도체가 좋아서가 아니라 전자회로를 통해 실제 칩이 설계되는 과정에 관심이 생겼고 직접 회로 설계 경험을 쌓고 싶다는 식으로 지원 동기를 준비하는 것이 좋습니다. 또한 본인이 할 질문도 준비하는 것이 좋습니다. 예를 들어 학부연구생이 주로 참여하는 연구 주제는 무엇인지, 처음 들어가면 어떤 툴이나 과제를 배우는지, 현재 연구실에서 사용하는 설계 툴은 무엇인지 등을 물어보면 관심도가 높게 보입니다. 아날로그 설계 연구실이라면 Cadence Virtuoso, Spectre 같은 툴을 사용하는 경우가 많기 때문에 관련 경험 여부도 확인하면 좋습니다. 정리하면 면담 전 준비 우선순위는 전자회로 기본 개념 복습, PLL과 ADC 구조 이해, ASIC 설계 흐름 파악, 지원 동기 정리입니다. 학부연구생 면담에서는 어려운 논문 내용을 완벽히 설명하는 것보다 기본기를 가지고 배우려는 자세와 꾸준히 연구할 수 있는 학생이라는 인상을 주는 것이 훨씬 중요합니다.

    2026.08.06


  • 합격 메이트삼성전자
    코부사장 ∙ 채택률 78%

    멘티님. 안녕하세요. ​품질관리 직무를 희망하신다면 기계 전공 지식을 증명하는 일반기계기사보다 전공 연관성과 직무 전문성을 직접 보여주는 품질경영기사에 무게를 두는 것이 훨씬 유용합니다. 실기 결과를 기다리시는 품질경영기사 최종 취득에 집중하시면서 6시그마 자격증과 연계된 역량을 다듬으시는 편이 서류 평가에서 더 높은 점수를 받습니다. ​Minitab을 활용한 공정 능력 분석이나 통계적 품질 관리 경험은 자기소개서에서 통계적 문제 해결 능력을 어필할 때 매우 강력한 요소로 작용합니다. 이미 우수한 학점과 어학 성적에 핵심 자격증까지 갖추고 계시므로 이번 하반기 공채에 주저 없이 바로 지원해보시는 전략을 권해드립니다. 공채 지원과 인턴 탐색을 병행하면서 실전 면접 감각을 익히다 보면 기대보다 빠르게 좋은 결과를 얻으실 수 있습니다. ​응원하겠습니다.

    2026.08.03


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